Consortium wint Innovate UK-subsidie ​​voor ontwikkeling cryogene CMOS IP

Update: 6 november 2021

Consortium wint Innovate UK-subsidie ​​voor ontwikkeling cryogene CMOS IP

Consortium wint Innovate UK-subsidie ​​voor ontwikkeling cryogene CMOS IP

Innovate UK heeft een subsidie ​​van £ 6.5 miljoen toegekend aan een zevenkoppig consortium onder leiding van SureCore met de opdracht om gezamenlijk geavanceerde cryogene Halfgeleider IP.

Het is te hopen dat dit werk de groei van de Quantum Computing (QC)-industrie drastisch zal versnellen door de beperkingen in verband met interconnects te verminderen en efficiënte qubit-/systeemschaling mogelijk te maken.

De architectuur van Quantum Computers in combinatie met gespecialiseerde algoritmen heeft de kracht om de computerefficiëntie te transformeren om problemen aan te pakken in disciplines die zich uitstrekken over fundamentele wetenschap, farmaceutica, financiën, logistiek en AI.

De meeste kwantumcomputerplatforms gebruiken qubits of componenten die werken bij cryogene temperaturen, maar bij deze platforms is er een gebrek aan geschikte regelcircuits die kunnen werken bij de cryogene temperaturen die nodig zijn om de werking van de qubits te beheren. Momenteel bevindt de besturingsschakeling zich op afstand van de qubits en is verbonden door dure en omvangrijke bekabeling om de extreme temperaturen die de qubits nodig hebben te vermijden. De hoeveelheid bekabeling die nodig is voor alle qubits vormt een fundamentele barrière voor QC-schaling.

Een voor de hand liggende oplossing is om de besturingselektronica samen met de qubits in de cryostaat te plaatsen, maar dit betekent dat beide op ultralage temperaturen moeten worden bewaard; in sommige implementaties tot bijna het absolute nulpunt. De ruimte in de cryostaat is echter niet alleen extreem beperkt, wat de miniaturisering van het regelcircuit noodzakelijk maakt, maar de moderne halfgeleiders waaruit deze chips bestaan, zijn alleen gekwalificeerd om te werken tot -40 ° C en bij die temperaturen zijn de bedrijfskarakteristieken van de transistors duidelijk veranderen.

Het doel van dit project is om deze gedragsverandering in wezen te begrijpen en te modelleren en vervolgens een portfolio van CryoCMOS IP te ontwerpen om de creatie van aangepaste chips mogelijk te maken die kunnen communiceren met de qubits bij cryogene temperaturen en controllerfunctionaliteit ondersteunen.

Veel bedrijven, vooral kleinere en startende bedrijven hier in Groot-Brittannië, zouden er enorm van profiteren als er een suite van CryoCMOS IP beschikbaar zou zijn voor licentieverlening op vrijwel dezelfde manier als standaard halfgeleider IP-licentiemodellen werken.

Het consortium bestaat uit het complete ecosysteem van bedrijven om de kerncompetenties te leveren die nodig zijn om deze cryotolerante IP snel te ontwikkelen. Dit zou dan onder licentie beschikbaar zijn voor bedrijven om hun eigen Cryo-CMOS-chipoplossingen te maken die het gebruiken, en ze een turbolading geven met een concurrentievoordeel in de wereld van Quantum Computing.

De eerste stap is om nauwkeurig te modelleren hoe transistors werken bij deze temperaturen. Dit wordt gedaan door SemiWise en de QC-onderzoeksgroep van de Universiteit van Glasgow.

Synopsys zal de gegenereerde gegevens gebruiken om zijn TCAD-tools te verfijnen. Een combinatie van metingen en simulatiegegevens zal door SemiWise worden gebruikt om de gieterij-PDK opnieuw te centreren voor cryogene temperaturen en om het ontwerp van het cryogene circuit mogelijk te maken.

Aangezien geheugen een sleutelrol speelt in de elektronica, wordt dit aspect afgehandeld door SureCore, dat het project leidt en wiens expertise in het laag houden van het stroomverbruik van de chip van vitaal belang is om ervoor te zorgen dat afvalwarmte tot een minimum wordt beperkt, zodat het de kamer.

Kamerexpertise wordt geleverd door Oxford Instruments, dat cryogene systemen produceert.

Ten slotte vertegenwoordigen Universal Quantum en SEEQC de behoeften van eindgebruikers en bepalen ze welke IP-blokken het project moet creëren voor de Cryo-CMOS-chips. Testchips zullen worden gekarakteriseerd bij de cryotemperaturen om de modellen en IP verder te verfijnen en te valideren.