アンリツカンパニーは、18月5.0日（水）にアンリツの最高の高速通信およびシステム設計会議であるDesignConで一連のアンリツテストトークを開催します。 終日の教育とライブデモンストレーションは、チップセット、ボード、およびシステム設計エンジニアに、PCIe 6.0およびXNUMXを含む新しい高速テクノロジー、および設計パフォーマンスを保証するための効果的なテストプロセスに関する洞察を提供します。
すべてのセッションは、サンノゼマッケンナリーコンベンションセンターのルーム210Fで開催されます。 DesignConダイヤモンドスポンサーのアンリツが実施する各セッションは、それぞれの技術に精通した経験豊富なエンジニアが主導します。
XNUMXつの教育セッションとデモンストレーション
9月00日（水）午前5時から午後00時まで、18回のアンリツテストトークが行われます。セッションの範囲は40〜60分です。 テストトークの概要は次のとおりです。
PCBを設計する際のシーケンシャルピーリング抽出とアンエンベディングの重要性
時間： 9午前： - ：00 9 40午前
要約： 差動デバイス、特にプリント回路基板（PCB）を設計およびテストするエンジニアは、ベクトルネットワークアナライザ（VNA）を使用して、設計サイクルを短縮し、市場投入までの時間を短縮します。 設計がより高い周波数に拡張され、ボードスペースが貴重になるにつれて、特定のVNAツールとテスト技術が重要になります。 参加者は、順次剥離抽出や埋め込み解除など、これらのアプローチについて学習します。
PCIe 5.0 RXLEQテストライブデモ用のオープンハウス
時間： 午前10時〜午前00時（参加者は時間中いつでも訪問できます）
要約： 実際の第5.0世代（G5）デバイステスト対象（DUT）を使用したライブPCIe 5LEQテストが実施されます。 来場者は、アンリツ信号品質アナライザー-RMP5Aを使用したG1900LEQテストのテスト手順を体験します。
PCIe4以降のPAM6.0BERおよびJTOLテストソリューション
時間： 11午前： - ：05 11 45午前
要約： このセッションでは、32ボー以上、PAM4 BERテスト、およびジッタ耐性（JTOL）測定の概要を説明します。 また、前方誤り訂正（FEC）とバーストエラー分析も含まれます。 PCIe6.0または400GE / 800GEアプリケーションに携わるエンジニアは、このセッションが非常に有益であることに気付くでしょう。
PAM4 BERTとJTOL、FEC、バーストエラー分析のライブデモ
時間： 12：00 pm - 12：45 pm
要約： 参加者は、MP4Aを使用したPAM1900JTOLテストとFECバーストエラー分析のライブデモンストレーションを見ることができます。 デモは次のように表示されます。
- PAM4BERT製品の概要と機能
- PAM4BERおよびジッタ許容度テスト
- FECバーストエラーのキャプチャと分析
自動車テストソリューション
時間： 2：00 pm - 2：40 pm
要約： このセッションでは、自動車向けのアンリツテストソリューションの概要を説明します。 議論される技術とアプリケーションの中には、5G /セルラー、インフォテインメント/接続性/ Bluetoothがあります® / WLAN、ADAS、RADAR、C-V2X、およびPCIe。
USBType-C標準PHYテスト。 何が同じで、何が違うのですか？
時間： 3：00 pm - 3：40 pm
要約： USB4とDisplayPortは、物理層の「ビルディングブロック」としてIntelのThunderboltPHY仕様を採用しています。 このセッションでは、コンプライアンステスト仕様（CTS）とテスト方法論に関連するこれらの標準の類似点と相違点について説明します。
PCIe5.0レシーバーLEQコンプライアンステスト
時間： 4：00 pm - 5：00 pm
要約： 最後のアンリツテストトークの参加者は、PCIe5.0の32.0GT / sでの新しいテストおよび測定レシーバーの課題を解決する方法について学びます。 取り上げるトピックは次のとおりです。
- PCI-SIG0コンプライアンスプログラム
- 32 GT / sレシーバーテストに関する課題と最新のガイドライン
- 32 GT / sのニュアンスは、目のキャリブレーションとイコライゼーションによる高損失バックチャネルの処理を強調しました
- レシーバーソリューションで検証の課題を解決する
教育セッションは無料で、DesignConのすべての参加者が参加できます。
詳細については、をご覧ください www.アンリツ.com
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