Attualmente N3, entrato in produzione in serie nel quarto trimestre del 4, è il processo più avanzato.
A seguire c'è N3E che è passato la tecnologia qualificazione e ha raggiunto i propri obiettivi di prestazione e rendimento. Ha ricevuto la prima ondata di tape-out dei prodotti dei clienti e inizierà la produzione in volumi nella seconda metà del 2023.
Il numero di nuovi tape-out per N3E è da 1.5 a 2 volte quello di N5 nello stesso periodo.
In arrivo sono:
N3P, che offre ulteriori vantaggi in termini di prestazioni e area preservando la compatibilità delle regole di progettazione con N3E per massimizzare il riutilizzo dell'IP. L'entrata in produzione è prevista per la seconda metà del 2024. Fornirà il 5% in più di velocità con la stessa perdita, una riduzione della potenza dal 5% al 10% alla stessa velocità e una densità di chip 1.04 volte superiore rispetto a N3E.
N3X, ottimizzato per le applicazioni HPC, fornisce un guadagno Fmax extra per aumentare le prestazioni dell'overdrive a un prezzo modesto compromesso con perdite. Ciò si traduce in un 5% in più di velocità rispetto a N3P alla tensione di pilotaggio di 1.2 V, con lo stesso miglioramento densità del chip come N3P. N3X entrerà in produzione in serie nel 2025.
N3AE, che è la prima tecnologia Auto Early del settore su 3nm, offre PDK automobilistici basati su N3E e consente ai clienti di lanciare progetti sul nodo 3nm per applicazioni automobilistiche, leader un processo N3A completamente qualificato per il settore automobilistico nel 2025.
N2, che si basa sul nanofoglio GAA Transistor, per la quale la produzione in volume è prevista per il 2025; N2P e N2X sono previsti per il 2026.
Le prestazioni del nanosheet Transistor ha superato l'80% degli obiettivi tecnologici dell'azienda, dimostrando al contempo potenza ed efficienza eccellenti e Vmin inferiore, afferma TSMC, il che è ottimo per l'elaborazione ad alta efficienza energetica.
TSMC ha esercitato la garanzia di progettazione N2 nell'implementazione fisica di un core CPU Arm A715 per misurare il miglioramento del PPA: ha ottenuto un aumento della velocità del 30% alla stessa potenza o una riduzione della potenza del 33% alla stessa velocità a circa 0.9 V, rispetto al N3E, ad alta densità, 2 a 1, cella standard ad alette.
Parte della piattaforma tecnologica TSMC, un binario di alimentazione posteriore, fornisce un ulteriore incremento di velocità e densità oltre alla tecnologia di base
Il power rail posteriore è più adatto per i prodotti HPC e sarà disponibile nella seconda metà del 2025.
La tecnologia migliora la velocità di oltre il 10-12% riducendo la caduta IR e i ritardi RC del segnale e riduce l'area frontale richiesta per la logica del 10-15%.
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